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Cadence使并發(fā)全芯片優(yōu)化和簽核速度提高10倍

來源: eetasia
2022-10-18
類別:行業(yè)趨勢(shì)
eye 19
文章創(chuàng)建人 拍明芯城

原標(biāo)題:Cadence使并發(fā)全芯片優(yōu)化和簽核速度提高10倍

Cadence通過其創(chuàng)新的Certus Closure Solution,成功地將并發(fā)全芯片優(yōu)化和簽核速度提高了10倍。這一突破性的解決方案為芯片設(shè)計(jì)行業(yè)帶來了顯著的效率和性能提升。以下是關(guān)于Cadence如何實(shí)現(xiàn)這一目標(biāo)的詳細(xì)分析:

  1. 技術(shù)背景

    • 在芯片設(shè)計(jì)領(lǐng)域,隨著設(shè)計(jì)尺寸和復(fù)雜性的不斷增長(zhǎng),傳統(tǒng)的設(shè)計(jì)收斂流程變得越來越耗時(shí)和低效。Cadence Certus Closure Solution正是為了解決這一挑戰(zhàn)而誕生的。

  2. 解決方案特點(diǎn)

    • Cadence Certus Closure Solution是一個(gè)完全自動(dòng)化的環(huán)境,實(shí)現(xiàn)了設(shè)計(jì)收斂的自動(dòng)化,并顯著縮短了整個(gè)設(shè)計(jì)收斂周期。通過該解決方案,從簽核優(yōu)化到布線、靜態(tài)時(shí)序分析(STA)和參數(shù)提取的整個(gè)過程可以在一夜之間完成,相比傳統(tǒng)的數(shù)周時(shí)間有了極大的提升。

    • 該解決方案支持無限容量的設(shè)計(jì)優(yōu)化和簽核,可以勝任大型芯片設(shè)計(jì)項(xiàng)目。與其他方法和流程相比,它最多可將生產(chǎn)力提高10倍。

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  1. 并行優(yōu)化和簽核

    • Cadence Certus Closure Solution采用了基于大規(guī)模并行技術(shù)的新架構(gòu),支持真正的全自動(dòng)化、大規(guī)模分布式層級(jí)全芯片優(yōu)化和簽核收斂。通過與Cadence的其他產(chǎn)品如Innovus Implementation System和Tempus Timing Signoff Solution共享同一個(gè)引擎,實(shí)現(xiàn)了并行全芯片優(yōu)化,使得模塊所有者無需進(jìn)行反復(fù)迭代,設(shè)計(jì)師也能快速做出優(yōu)化和簽核決定。

  2. 可擴(kuò)展架構(gòu)和增量簽核

    • Cadence Certus Closure Solution的分布式分層優(yōu)化和簽核架構(gòu)是云執(zhí)行的理想選擇,既可以在云環(huán)境中運(yùn)行,也可以在本地?cái)?shù)據(jù)中心環(huán)境中運(yùn)行。此外,它還支持增量簽核,即只針對(duì)設(shè)計(jì)中經(jīng)過變更的部分提供靈活的重置和替換,進(jìn)一步加快了最終簽核速度。

  3. 行業(yè)應(yīng)用

    • Cadence Certus Closure Solution不僅提高了設(shè)計(jì)收斂的速度和效率,還降低了開發(fā)新興應(yīng)用的復(fù)雜性,如超大規(guī)模計(jì)算、5G通信、移動(dòng)、汽車和網(wǎng)絡(luò)等。這些領(lǐng)域?qū)τ谠O(shè)計(jì)收斂的速度和準(zhǔn)確性有著極高的要求,Cadence Certus Closure Solution的推出為這些領(lǐng)域的發(fā)展提供了強(qiáng)有力的支持。

綜上所述,Cadence通過其Certus Closure Solution成功地將并發(fā)全芯片優(yōu)化和簽核速度提高了10倍,為芯片設(shè)計(jì)行業(yè)帶來了革命性的變革。這一解決方案的推出不僅提高了設(shè)計(jì)收斂的速度和效率,還降低了開發(fā)復(fù)雜應(yīng)用的難度,為行業(yè)的發(fā)展注入了新的活力。


責(zé)任編輯:David

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標(biāo)簽: Cadence Certus Closure

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