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UMC 和 Cadence 合作開發(fā) 22ULP/ULL 工藝節(jié)點的模擬/混合信號流程

來源: eetasia
2022-08-29
類別:業(yè)界動態(tài)
eye 54
文章創(chuàng)建人 拍明芯城

原標(biāo)題:UMC 和 Cadence 合作開發(fā) 22ULP/ULL 工藝節(jié)點的模擬/混合信號流程

UMC(United Microelectronics Corporation,聯(lián)華電子)和Cadence Design Systems在模擬/混合信號(AMS)設(shè)計流程方面針對22ULP/ULL工藝節(jié)點展開了深入的合作。以下是關(guān)于這次合作的一些關(guān)鍵信息:

  1. 合作目標(biāo)
    -UMC和Cadence共同的目標(biāo)是為22ULP(超低功耗)和22ULL(超低漏電)工藝節(jié)點提供優(yōu)化的模擬/混合信號設(shè)計流程。

  2. 技術(shù)認(rèn)證
    -Cadence的AMS設(shè)計流程已經(jīng)獲得UMC的22ULP與22ULL制程認(rèn)證,這意味著該流程能夠充分利用UMC的先進(jìn)制程技術(shù)。

  3. 優(yōu)化特點
    -該流程可以優(yōu)化制程效率,縮短設(shè)計時間,加速5G、物聯(lián)網(wǎng)和顯示等應(yīng)用設(shè)計開發(fā)。
    -與28納米制程相比,UMC的22納米制程能夠再縮減10%的晶粒面積,并擁有更佳的功率性能以及強化的射頻性能。

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  1. 流程組成
    -Cadence AMS流程包括VirtuosoR平臺(支持原理圖編輯、模擬設(shè)計環(huán)境ADE和布局XL工具),SpectreR AMS Designer(結(jié)合Spectre X Simulator和Xcelium Logic Simulation引擎的功能),以及Voltus-Fi定制化電源完整性解決方案等。

  2. 設(shè)計支持
    -該流程提供集成可靠度接口(URI),確保在22納米制程設(shè)計時的電路可靠度及使用壽命。
    -設(shè)計流程還提供示范電路,使用戶在設(shè)計時能夠靈活套用,提高設(shè)計效率與精確性。

  3. 市場影響
    -UMC和Cadence的合作,為UMC 22ULP與22ULL制程技術(shù)的芯片客戶提供業(yè)界領(lǐng)先的可靠與高效率的流程方案,并獲得設(shè)計上定制化的支持。
    -這有助于客戶提升生產(chǎn)力,并快速完成全芯片設(shè)計定案,增進(jìn)芯片設(shè)計的速度與效率。

  4. 未來發(fā)展
    -隨著5G、物聯(lián)網(wǎng)和顯示等技術(shù)的不斷發(fā)展,對于低功耗、高性能的芯片需求將持續(xù)增長。UMC和Cadence的合作將持續(xù)推動這一領(lǐng)域的創(chuàng)新與發(fā)展。

綜上所述,UMC和Cadence在22ULP/ULL工藝節(jié)點的模擬/混合信號設(shè)計流程上的合作,不僅展示了雙方在半導(dǎo)體設(shè)計和制造領(lǐng)域的實力,也為芯片設(shè)計行業(yè)帶來了更為先進(jìn)和高效的解決方案。


責(zé)任編輯:David

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標(biāo)簽: UMC Cadence 22ULP/ULL

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